SDRAM-DDRxx类型、信号、关键参数
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DDR各版本类型
DDR各版本信号说明
DDR相关学习总结，部分数据可能有误，欢迎指正。
| 大类 | DDR类型 | VDD (核心) | VDDQ (I/O) | 最高速率 (JEDEC) | 备注 |
|---|---|---|---|---|---|
| 标准 DDR | DDR1 | 2.5 V | 2.5 V | 400 MT/s | 已淘汰，芯片级罕见 |
| DDR2 | 1.8 V | 1.8 V | 1066 MT/s | 存量工业/通信设备 | |
| DDR3 | 1.5 V | 1.5 V | 2133 MT/s | 通用型芯片，支持 1.35 V 低功耗模式 | |
| DDR3L | 1.35 V | 1.35 V | 同 DDR3 | 低功耗版，引脚兼容 DDR3 | |
| DDR4 | 1.2 V | 1.2 V | 3200 MT/s | 主流嵌入式/服务器芯片 | |
| DDR4L | 1.05 V | 1.05 V | 同 DDR4 | 超低功耗版，芯片级已量产 | |
| DDR5 | 1.1 V | 1.1 V | 6400 MT/s | 新一代芯片，支持片上 ECC | |
| 低功耗 LPDDR | LPDDR1 | 1.8 V | 1.8 V | 400 MT/s | PoP/独立封装，早期手机 |
| LPDDR2 | 1.2 V | 1.2 V | 1066 MT/s | 支持 NVM/DRAM 混合封装 | |
| LPDDR3 | 1.2 V | 1.2 V | 2133 MT/s | 平板/车载芯片主流 | |
| LPDDR4 | 1.1 V | 1.1 V | 4266 MT/s | 双 16-bit 通道，芯片级 200-ball | |
| LPDDR4X | 1.1 V | 0.6 V | 4266 MT/s | I/O 电压降低 45 % | |
| LPDDR5 | 1.05 V | 1.05 V | 6400 MT/s | 引入 WCK 差分时钟 | |
| LPDDR5X | 1.05 V | 0.9 V | 8533 MT/s | 信号电压进一步降低 | |
| 图形 GDDR | GDDR3 | 1.8 V | 1.8 V | 2.5 Gb/s/pin | 早期 GPU 显存芯片 |
| GDDR5 | 1.5 V | 1.5 V | 8 Gb/s/pin | 单 32-bit 通道，BGA 170-ball | |
| GDDR6 | 1.35 V | 1.35 V | 16 Gb/s/pin | 双 16-bit 通道，BGA 180-ball | |
| GDDR6X | 1.35 V | 1.35 V | 21–24 Gb/s/pin | 非 JEDEC，Micron 独家芯片 | |
| 遗留 | LPSDR | 3.3 V | 3.3 V | 133 MT/s | 早期功能机基带芯片，已停产 |
- DDR4L 并非民间俗称，JEDEC 规范里确实定义了 1.05 V 的 DDR4（文档编号 JESD79-4C Annex）。LPDDR5X 已正式发布（JESD209-5B），速率 8533 Mb/s，2022 年起量产。GDDR6X 是 Micron+NVIDIA 的“超规”方案，JEDEC 尚未收录，但市售显卡已大量采用。LPSDR（Low-Power SDR）属于 SDRAM 时代产物，严格说不是 DDR 家族，但部分资料会把它列进来。
- Wordline supply voltage（Vpp）是 DRAM 中专门用来驱动 字线（Wordline） 的独立电源轨，早期 DDR3 由内部电荷泵从 VDD 升压生成，不引出外部引脚；DDR4 起芯片直接提供 Vpp 引脚，需外部供电。
SDRAM引脚说明
- 地址/选通类
| 符号 | 类型 | 详细功能（一句话总结） | 典型连接/注意 |
|---|---|---|---|
| A0–A12 | IN | 行地址 13 位，列地址 10/9 位；PRECHARGE 时 A10=1 表示全 bank；LOAD MODE 时当操作码 | 直接连 MCU/FPGA 地址总线 |
| BA0, BA1 | IN | 选 4 个 bank 之一 | 若两片并联，BA共用，用 CS# 区分 |
- 命令类（RAS/CAS/WE/CS/CKE）
| 符号 | 类型 | 功能 | 典型连接/注意 |
|---|---|---|---|
| RAS# | IN | 低电平时表示“行有效”或“预充电”命令的一部分 | 与 CAS#/WE# 一起由 主控制器的 FMC/FSMC 控制器驱动 |
| CAS# | IN | 低电平时表示“列有效”或“读/写”命令的一部分 | 同上 |
| WE# | IN | 低电平时表示写；高电平表示读 | 同上 |
| CS# | IN | 片选；高电平时器件忽略所有命令 | 多片并联时，每片独立 CS#；单器件可直接接地 |
| CKE | IN | 时钟使能；低电平进入掉电/自刷新 | 上电后保持高；进入低功耗模式时由主控拉低 |
| CLK | IN | 主时钟；所有输入在上升沿采样 | 单端走线，串 22–33 Ω 阻尼电阻，长度 < 2 inch |
- 数据/屏蔽类
| 符号 | 类型 | 功能 | 典型连接/注意 |
|---|---|---|---|
| DQ0–DQ7 / DQ0–DQ15 | I/O | 双向数据总线 | 与控制器 DQ xx相对应；做 50 Ω 单端阻抗；分组等长 ±25 mil |
| DQML / DQMH (x16) | IN | 低字节/高字节屏蔽；读时相当于 OE，写时相当于 Mask | 连 MCU 的 NBL0/NBL1或 LDQM/UDQM |
| DQM (x8) | IN | 单字节屏蔽 | 连控制器的 DQM |
- 电源/地
| 符号 | 类型 | 功能 | 典型连接/注意 |
|---|---|---|---|
| VDD | PWR | 核心 3.3 V | 100 nF + 1 µF 去耦，每 2–3 引脚一组 |
| VDDQ | PWR | I/O 3.3 V | 可与 VDD 共电源，但需独立去耦 |
| VSS, VSSQ | GND | 核心地 / I/O 地 | 就近打地孔，星形接地 |
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